简单聊聊FPGA的一些参数
笔者：E林1010 在上一篇中，我们已经知道了，FPGA的几个主流厂家和其中Intel家族中FPGA的系列的分类。 上一篇文章链接： https://mp.weixin.qq.com/s/1YufdRZ3Kvvk1znDGu69Og 本文微信公众号链接： https://mp.weixin.qq.c...
产品推荐 | 中科亿海微推出亿迅®A8000金融FPGA加速卡-产品特性
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时隔两周，Hadoop 3.1版本发布，支持GPU和FPGA
3月25日，Hadoop 3.0.1版本正式发布，这也让Hadoop正式迈入3.0时代。时隔两周，Apache Hadoop 3.1.0正式发布。与之前的版本（hadoop-3.0）相比，新版本具有许多重要的增强功能，比如支持GPU和FPGA。不过，新版本暂不推荐在正式生产环境中使用。如果需要，请等...
UDP的FPGA实现（上） | 操作基础与理论分析
本系列分为上中下三层，分别是：（上）：操作基础与IP、端口、MAC初步介绍（本篇）（中）：udp，IP、MAC帧结构（下）：UDP工程分析一、操作知识“本地连接”只出现于Win7和XP中，在Win8和win10系统，被更名为“以太网”。（.....大声重复.....）在比较老的教程中，程序在win7...
FPGA vivado系统集成操作
本文档系列是我在实践将简单的神经网络LeNet-5实现到Xilinx 的zynq-7z035的FPGA上遇到的问题和解决方法。本文档重点探讨vivado软件的使用。完成此过程可以参阅的文档有UG892: Design Flows Overview 设计流程概览UG895：System-Level D...
FPGA固件程序烧写配置方案
Intel 或 Xilinx 的 FPGA 芯片，使用的是基于 SRAM 结构的查找表，而 SRAM的一大特性就是掉电数据会丢失。当使用 JTAG 将 SRAM 配置文件（.sof）配置到 FPGA 芯片中后，这些数据是直接存储在 SRAM 结构的查找表中的，因此，一旦芯片掉电，则 SRAM 中的数...
Xilinx FPGA的上电配置过程
Xilinx FPGA的上电配置过程——进阶篇 总结Xilinx FPGA的上电模式可以分为以下4类型： 1. 主模式 2. 从模式 3. JTAG模式（调试模式） 4. 系统模式（多片配置模式） 主模式 典型的主模式都是加载片外非易失( 断电不丢数据) 性存储器中的配置比特流，配置所需的时钟信号(...
Xilinx FPGA通过FLASH加载程序的时序
尽管FPGA的配置模式各不相同，但整个配置过程中FPGA的工作流程是一致的，分为三个部分：设置、加载、启动。复位结束配置开始有多种方式使FPGA的配置进入这一过程。在上电时，电压达到FPGA要求之前，FPGA的上电复位模块将使FPGA保持在复位状态;外部控制PROG_B引脚出现一个低脉冲也可以使FP...
Xilinx 7系列FPGA 高速收发器GTX/GTH的一些基本概念
本来写了一篇关于高速收发器的初步调试方案的介绍，给出一些遇到问题时初步的调试建议。但是发现其中涉及到很多概念。逐一解释会导致文章过于冗长。所以单独写一篇基本概念的介绍，基于Xilinx 7系列的GTX。需要说明，文本只是初步介绍基本概念，会尽量使用通俗浅显的描述而避免使用专业词汇，也只会描述一些基...
荔枝糖Lichee Tang FPGA（安陆，Analogic, 20K LUT）调试蜂鸟E203 RV helloworld
2020年5月份，因为老婆有笔几百块钱的经费，所以买了一块荔枝糖FPGA加调试器玩玩；那就顺便玩玩有人已经跑通的蜂鸟E203软核。上手后，安陆的TD软件安装很顺利，官方教程上也下载了带有全套工具链和环境的Ubuntu虚拟机。照着群里的教程想搞一个helloworld玩玩，问题来了。首先是hellow...
基于FPGA的XC7K325T光纤传输PCIE光纤卡、4路光纤卡在数据中心的应用
数据中心是一整套复杂的设施。它不仅仅包括计算机系统和其它与之配套的设备（例如通信和存储系统），还包含冗余的数据通信连接、环境控制设备、监控设备以及各种安全装置”。谷歌在其发布的《TheDatacenter as a Computer》一书中，将数据中心解释为“多功能的建筑物，能容纳多个...
基于RGMII的FPGA千兆以太网设计
一．总体概括千兆以太网的理论网速为1000Mbit/s，实际网速接近该值，但几乎不可能达到，但相对于百兆网，网速快了很多。目前千兆以太网常用物理层接口有GMII和RGMII，两种接口有同有异，应用情况也有所差别。GMII占用的引脚较多，RGMII可以很大程序地减少引脚的使用。因此本设计采用RGMII...
【工程源码】无法下载FPGA程序，无法start，找不到下载器
本文和设计代码由FPGA爱好者小梅哥编写，未经作者许可，本文仅允许网络论坛复制转载，且转载时请标明原作者。 很多新手在刚开始接触FPGA学习的时候，都不会下载程序，经常出现无法下载程序，或者说下载窗口找不到下载器，或者Start按钮是灰色的情况，如下图1所示： 这种情况下，会显示NoHardware...
xilinx fpga硬件调试
fpga硬件调试 (一)----mark_debug最近两个月开始用Vivado做项目，之前一直用ISE开发，个人觉得ISE方便好用，而Vivado编译又慢，还占内存，打开一个工程就需要好半天，可视化界面感觉也没什么用处，不如模块化的代码来的简单，而且还有一些bug。无奈xilinx公司不再开发I...
FPGA ZYBO vivado使用MicroBlaze软核控制GPIO（按键加LED）
从创建工程开始写吧。点击Create Project创建一个工程。文件名啥的就不说了，直接选择板子型号选择的板子是ZYBO，如果没有找到板子的话，则需要到vivado的安装mulxia替换下面的文件，使之包括该型号的板子下面开始正式工程的配置。点击Create Block Design创建一个IP，...
【黑金原创教程】【FPGA那些事儿-驱动篇I 】实验十七：IIC储存模块 - FIFO读写...
1. int main()2. {3. int A；4. A = 16；5. }代码17.1话题为进入之前，首先让我们来聊聊一些题外话。那些学过软核NIOS的朋友可曾记得，软核NIOS可利用片上内存作为储存资源，而且它也能利用SDRAM作为储存资源，然而问题是在这里 ... 如代码17.1所示，笔者...
Xilinx FPGA 学习笔记——原语 BUFIO 的理解
转载出处： https://blog.csdn.net/lg2lh/article/details/45375317 我一直没搞明白BUFIO是干嘛用的。官方解释有这么一段话，如下：（virtex的）“BUFIO是用来驱动I/O列内的专用时钟网络，这个专用的时钟网络独立于全局时钟资源，适合采集源同步...
FPGA通过SPI对ADC配置简介（二）-------4线SPI配置时序分析
本篇将以德州仪器(TI)的高速ADC芯片——ads52j90为例，进行ADC的4线SPI配置时序介绍与分析。 从ads52j90的数据手册我们不难发现，其SPI控制模块主要包含4根信号线，即SEN、SCLK、SDIN以及SDOUT。TI公司对其产品SPI配置信号的命名方式与...
在Xilinx FPGA上快速实现 JESD204B
简介JESD204是一种连接数据转换器（ADC和DAC）和逻辑器件的高速串行接口，该标准的 B 修订版支持高达 12.5 Gbps串行数据速率，并可确保 JESD204 链路具有可重复的确定性延迟。随着转换器的速度和分辨率不断提升，JESD204B接口在ADI高速转换器和集成RF收发器中也变得更为常...
04-ZYNQ学习之FPGA+Linux开发的流程
通过前面3节内容，我们知道了：Xilinx ZYNQ的内部结构PL端FPGA的开发过程ZYNQ启动过程及固化 那么ZYNQ包含CortexTM-A9核，那么它的ARM资源应用主要就落在嵌入式linux上。ZYNQ的嵌入式Linux开发流程是本节介绍的重点。一、嵌入式linux开发三要点嵌入式linu...