VLSI课程实验案列报告

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文件名称：VLSI课程实验案列报告

文件大小：1.29MB

文件格式：DOCX

更新时间：2022-09-27 04:19:07

VLSI cadence virtuoso

cadence virtuoso设计反相器的电路图，版图并通过相应的DRC和LVS；并设计了三种或非门的电路图；最后设计了静态存储器并提取CDL网表，通过Hspice建立完成时间、保持时间和C-Q延时的仿真